Red-RISCV: Red-RISCV: Investigación, Formación e Innovación en Sistemas RISC-V y Open-source Hw/Sw
Description
Actualmente existen múltiples procesadores comerciales para el desarrollo de sistemas HW/SW, pero todos ellos son núcleos con un repertoriode instrucciones (ISA) cerrado, protegido y propietario, cuyo uso está sometido a caras licencias de explotación o limitado a la utilización decomponentes y sistemas de desarrollo disponibles en el mercado. Uno de los ejemplos es la familia de procesadores RISC ARM que actualmente dominan ampliamente el mercado.
Cualquier SoC (System on Chip) que incluya algún núcleo ARM se ve sometido al pago deroyalties vía compra de la IP al diseñador del núcleo o de la licencia arquitectural.Todo ello sucede en un momento donde el software abierto es ya una realidad que ha facilitado enormemente su evolución, uso y adaptaciónpara aplicaciones específicas. Así mismo, en términos de microelectrónica y desde el punto de vista de desarrollo de SoCs específicos, losprocesos son cada vez más asequibles y viables tanto técnica como económicamente, excepto si se incluye un núcleo procesador propietarioen cuyo caso los costes de las licencias y de la infraestructura de base son disuasorios para la mayoría de las empresas.
Durante la última década se ha ido fraguando una iniciativa nacida en la Universidad de California en Berkeley para el desarrollo del procesadorRISC-V de ISA abierto y público que eliminaría la mayor parte de las restricciones impuestas por los ISAs propietarios y haría accesible acualquier empresa el uso de tales arquitecturas libres de royalties, abriendo una senda para el hardware abierto y libre.De la misma forma que los procesadores ARM dominan el mercado actual, cabe decir que la onda expansiva del ecosistema creado alrededordel RISC-V está dominando las tendencias y estrategias de futuro y promete una rápida democratización del hardware y su avance hacia elopen-source Hw/Sw. De hecho, la Comisión Europea ha identificado el ISA abierto RISC-V como el ISA del futuro acelerador europeo en elmarco del European Processor Initiative (EPI). Este diseño está siendo liderado por el Barcelona Supercomputing Center (BSC), promotor deesta red junto al Centro Nacional de Microelectrónica (CNM). En esta propuesta se hace especial énfasis en la necesaria combinación de dos perfiles complementarios para cubrir sólidamente toda lacadena de desarr